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Trabalho de evento
Performance comparison of high-speed dual modulus prescalers using metaheuristic sizing/optimization (2020)
Soares Junior, João Navarro ; Luppe, Maximiliam
Source: Proceedings. Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: EESC
Subjects: CONSUMO DE ENERGIA ELÉTRICA, ENGENHARIA ELÉTRICA
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ABNT
SOARES JUNIOR, João Navarro e LUPPE, Maximiliam. Performance comparison of high-speed dual modulus prescalers using metaheuristic sizing/optimization. 2020, Anais.. New York, NY, USA: ACM, 2020. Disponível em: https://doi.org/10.1109/SBCCI50935.2020.9189913. Acesso em: 01 maio 2024.
APA
Soares Junior, J. N., & Luppe, M. (2020). Performance comparison of high-speed dual modulus prescalers using metaheuristic sizing/optimization. In Proceedings. New York, NY, USA: ACM. doi:10.1109/SBCCI50935.2020.9189913
NLM
Soares Junior JN, Luppe M. Performance comparison of high-speed dual modulus prescalers using metaheuristic sizing/optimization [Internet]. Proceedings. 2020 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1109/SBCCI50935.2020.9189913
Vancouver
Soares Junior JN, Luppe M. Performance comparison of high-speed dual modulus prescalers using metaheuristic sizing/optimization [Internet]. Proceedings. 2020 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1109/SBCCI50935.2020.9189913
Trabalho de evento
Design of a low power 10-bit 12MS/s asynchronous SAR ADC in 65nm CMOS (2019)
Campos, Arthur Lombardi; Soares Junior, João Navarro; Luppe, Maximiliam
Source: Proceedings. Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: EESC
Subjects: CIRCUITOS INTEGRADOS, CONVERSORES ELÉTRICOS, ENGENHARIA ELÉTRICA
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ABNT
CAMPOS, Arthur Lombardi e SOARES JUNIOR, João Navarro e LUPPE, Maximiliam. Design of a low power 10-bit 12MS/s asynchronous SAR ADC in 65nm CMOS. 2019, Anais.. New York, NY, USA: ACM, 2019. Disponível em: https://doi.org/10.1145/3338852.3339857. Acesso em: 01 maio 2024.
APA
Campos, A. L., Soares Junior, J. N., & Luppe, M. (2019). Design of a low power 10-bit 12MS/s asynchronous SAR ADC in 65nm CMOS. In Proceedings. New York, NY, USA: ACM. doi:10.1145/3338852.3339857
NLM
Campos AL, Soares Junior JN, Luppe M. Design of a low power 10-bit 12MS/s asynchronous SAR ADC in 65nm CMOS [Internet]. Proceedings. 2019 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1145/3338852.3339857
Vancouver
Campos AL, Soares Junior JN, Luppe M. Design of a low power 10-bit 12MS/s asynchronous SAR ADC in 65nm CMOS [Internet]. Proceedings. 2019 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1145/3338852.3339857
Trabalho de evento
Run-time cache configuration for the LEON-3 embedded processor (2015)
Silva, Bruno A; Cuminato, Lucas A; Bonato, Vanderlei ; Diniz, Pedro C
Source: Proceedings. Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: ICMC
Subjects: SISTEMAS EMBUTIDOS, COMPUTAÇÃO EVOLUTIVA, ROBÓTICA
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ABNT
SILVA, Bruno A et al. Run-time cache configuration for the LEON-3 embedded processor. 2015, Anais.. New York: ACM, 2015. Disponível em: https://doi.org/10.1145/2800986.2801026. Acesso em: 01 maio 2024.
APA
Silva, B. A., Cuminato, L. A., Bonato, V., & Diniz, P. C. (2015). Run-time cache configuration for the LEON-3 embedded processor. In Proceedings. New York: ACM. doi:10.1145/2800986.2801026
NLM
Silva BA, Cuminato LA, Bonato V, Diniz PC. Run-time cache configuration for the LEON-3 embedded processor [Internet]. Proceedings. 2015 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1145/2800986.2801026
Vancouver
Silva BA, Cuminato LA, Bonato V, Diniz PC. Run-time cache configuration for the LEON-3 embedded processor [Internet]. Proceedings. 2015 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1145/2800986.2801026
Trabalho de evento
Design for stability of active inductor with feedback resistance (2014)
Guerreiro, Gabriel Rebello; Soares Junior, João Navarro
Source: Proceedings. Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: EESC
Subjects: CIRCUITOS INTEGRADOS, ENGENHARIA ELÉTRICA
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ABNT
GUERREIRO, Gabriel Rebello e SOARES JUNIOR, João Navarro. Design for stability of active inductor with feedback resistance. 2014, Anais.. Rio de Janeiro, RJ: Escola de Engenharia de São Carlos, Universidade de São Paulo, 2014. Disponível em: http://dx.doi.org/10.1145/2660540.2660549. Acesso em: 01 maio 2024.
APA
Guerreiro, G. R., & Soares Junior, J. N. (2014). Design for stability of active inductor with feedback resistance. In Proceedings. Rio de Janeiro, RJ: Escola de Engenharia de São Carlos, Universidade de São Paulo. doi:10.1145/2660540.2660549
NLM
Guerreiro GR, Soares Junior JN. Design for stability of active inductor with feedback resistance [Internet]. Proceedings. 2014 ;[citado 2024 maio 01 ] Available from: http://dx.doi.org/10.1145/2660540.2660549
Vancouver
Guerreiro GR, Soares Junior JN. Design for stability of active inductor with feedback resistance [Internet]. Proceedings. 2014 ;[citado 2024 maio 01 ] Available from: http://dx.doi.org/10.1145/2660540.2660549
Trabalho de evento
A CMOS bandgap reference circuit with a temperature coefficient adjustment block (2013)
Ishibe, Eder Issao; Soares Júnior, João Navarro
Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: EESC
Subjects: MÉTODO DE MONTE CARLO, CIRCUITOS INTEGRADOS
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ABNT
ISHIBE, Eder Issao e SOARES JÚNIOR, João Navarro. A CMOS bandgap reference circuit with a temperature coefficient adjustment block. 2013, Anais.. Piscataway: IEEE, 2013. . Acesso em: 01 maio 2024.
APA
Ishibe, E. I., & Soares Júnior, J. N. (2013). A CMOS bandgap reference circuit with a temperature coefficient adjustment block. In . Piscataway: IEEE.
NLM
Ishibe EI, Soares Júnior JN. A CMOS bandgap reference circuit with a temperature coefficient adjustment block. 2013 ;[citado 2024 maio 01 ]
Vancouver
Ishibe EI, Soares Júnior JN. A CMOS bandgap reference circuit with a temperature coefficient adjustment block. 2013 ;[citado 2024 maio 01 ]
Trabalho de evento
Top-down design for low power multi-bit sigma-delta modulator (2012)
Alarcon Cubas, Heiner Grover ; Soares Junior, João Navarro
Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: EESC
Subjects: MODULAÇÃO DIGITAL, CIRCUITOS ELETRÔNICOS
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ABNT
ALARCON CUBAS, Heiner Grover e SOARES JUNIOR, João Navarro. Top-down design for low power multi-bit sigma-delta modulator. 2012, Anais.. Piscataway, NJ: IEEE, 2012. Disponível em: https://doi.org/10.1109/SBCCI.2012.6344448. Acesso em: 01 maio 2024.
APA
Alarcon Cubas, H. G., & Soares Junior, J. N. (2012). Top-down design for low power multi-bit sigma-delta modulator. In . Piscataway, NJ: IEEE. doi:10.1109/SBCCI.2012.6344448
NLM
Alarcon Cubas HG, Soares Junior JN. Top-down design for low power multi-bit sigma-delta modulator [Internet]. 2012 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1109/SBCCI.2012.6344448
Vancouver
Alarcon Cubas HG, Soares Junior JN. Top-down design for low power multi-bit sigma-delta modulator [Internet]. 2012 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1109/SBCCI.2012.6344448
Trabalho de evento
A 4.1 GHz prescaler using double data throughput E-TSPC structures (2007)
Miranda, Fernando Pedro Henriques de; Soares Junior, João Navarro ; Van Noije, Wilhelmus Adrianus Maria
Source: Proceedings. Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidades: EESC, EP
Assunto: ENGENHARIA ELÉTRICA
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
MIRANDA, Fernando Pedro Henriques de e SOARES JUNIOR, João Navarro e VAN NOIJE, Wilhelmus Adrianus Maria. A 4.1 GHz prescaler using double data throughput E-TSPC structures. 2007, Anais.. Rio de Janeiro, RJ: Escola de Engenharia de São Carlos, Universidade de São Paulo, 2007. Disponível em: http://dx.doi.org.br/10.1145/1284480.1284518. Acesso em: 01 maio 2024.
APA
Miranda, F. P. H. de, Soares Junior, J. N., & Van Noije, W. A. M. (2007). A 4.1 GHz prescaler using double data throughput E-TSPC structures. In Proceedings. Rio de Janeiro, RJ: Escola de Engenharia de São Carlos, Universidade de São Paulo. doi:10.1145/1284480.1284518
NLM
Miranda FPH de, Soares Junior JN, Van Noije WAM. A 4.1 GHz prescaler using double data throughput E-TSPC structures [Internet]. Proceedings. 2007 ;[citado 2024 maio 01 ] Available from: http://dx.doi.org.br/10.1145/1284480.1284518
Vancouver
Miranda FPH de, Soares Junior JN, Van Noije WAM. A 4.1 GHz prescaler using double data throughput E-TSPC structures [Internet]. Proceedings. 2007 ;[citado 2024 maio 01 ] Available from: http://dx.doi.org.br/10.1145/1284480.1284518
Trabalho de evento
Reusing hardware components with single-state processes (1999)
Melo, Ana Cristina Vieira de
Source: Proceedings. Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: IME
Subjects: HARDWARE, ÁLGEBRA, CIRCUITOS INTEGRADOS, MODELOS MATEMÁTICOS
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
MELO, Ana Cristina Vieira de. Reusing hardware components with single-state processes. 1999, Anais.. Piscataway: IEEE, 1999. Disponível em: https://doi.org/10.1109/SBCCI.1999.803102. Acesso em: 01 maio 2024.
APA
Melo, A. C. V. de. (1999). Reusing hardware components with single-state processes. In Proceedings. Piscataway: IEEE. doi:10.1109/SBCCI.1999.803102
NLM
Melo ACV de. Reusing hardware components with single-state processes [Internet]. Proceedings. 1999 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1109/SBCCI.1999.803102
Vancouver
Melo ACV de. Reusing hardware components with single-state processes [Internet]. Proceedings. 1999 ;[citado 2024 maio 01 ] Available from: https://doi.org/10.1109/SBCCI.1999.803102

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